广东
大家聊 AI 算力，目光大多集中在 GPU 大芯片上，却很少注意，存储设备与配套半导体设备，才是卡住性能天花板的隐形关卡。当传统二维 DRAM 已经摸到物理天花板，整个行业开始转向垂直堆叠的 3D DRAM 路线，而国内设备厂商北方华创，刚刚交出了一份关键的工艺答卷。
近期，北方华创在 IEEE 国际期刊发布论文，公开面向 3D DRAM 的两步循环刻蚀工艺，专门针对 64 层硅、硅锗交替堆叠的复杂芯片结构做优化，实现超过 95% 的结构均匀度，硅锗对硅刻蚀选择比突破 500:1，夹层结构里硅层单次损耗被控制在 10 埃，也就是 1 纳米以内。
很多人看不懂这一串参数，打个通俗比方：这就好比一摞几十层的复合板材，需要精准把其中一层材料掏空剥离，同时不能划伤、弄坏上下相邻的板材。过去这是 3D 堆叠制造中最难啃的工程难题，刻蚀深浅不均匀，或者误伤不该动的材料，整片晶圆就直接报废，良率会直接崩盘。
这套 “刻蚀‑清理副产物” 循环工作模式，就是专门解决高深堆叠内部残渣堆积、底层刻蚀不到位的痛点。先定向刻蚀目标层，同时在硅表面形成保护膜避免损伤；再清理掉反应产生的固体碎屑，保证深层腔体反应可以持续进行，反复循环完成多层结构加工。
为什么 3D DRAM 会成为全球存储行业的必争之地？传统 DRAM 一直靠在平面上不断缩小晶体管尺寸来提升密度。但走到 10 纳米附近之后，物理瓶颈已经显现。DRAM 依靠电容器保存电荷，单元做的太小，电容存不住足够电子，就会出现漏电、数据丢失，再拼命缩小线宽已经没有实际意义。继续往下硬冲，高度依赖 EUV 极紫外光刻机，设备成本和制造难度都会暴涨。
于是行业思路发生根本性转变：不再执着于平面上 “越做越小”，转向往 Z 轴垂直方向 “越堆越高”，模仿 3D NAND 闪存的堆叠逻辑，依靠多层叠加来提升存储容量，这就是 3D DRAM 的核心逻辑。
几乎同一时间段，AMD 也对外披露混合键合架构的 3D DRAM 方案。和现在 AI 服务器广泛使用的 HBM 不一样，它不再把内存堆放在芯片侧边，而是直接堆叠在 XPU 计算芯片上方，放弃微凸块焊球，用铜‑铜直接键合，大幅缩短数据搬运距离，官方给出的实验室数据，能效对比传统 HBM 堆栈最高可以提升 17 倍。
三星、SK 海力士、美光三家海外存储巨头，早已在 3D DRAM 各条技术路线布局。三星规划 2028 年推进 3D DRAM 量产，已经完成 16 层堆叠原型；SK 海力士探索垂直栅极与新型沟道材料；美光也积累了大量相关专利，各家都在抢下一代存储的时间窗口。
北方华创这次的刻蚀工艺，属于制造链条上的关键一环，但也仅仅只是一环。实验室论文的工艺成果，距离稳定大规模量产设备，中间还有材料匹配、整机调试、产线磨合漫长的距离。就算设备跑通，还需要存储设计厂商、晶圆制造、键合封装整条产业链协同配合，不是单一环节突破就可以直接实现弯道超车。
但它的象征意义不容忽视。过去我们在先进平面 DRAM 节点处处受限，而 3D DRAM 属于行业共同开启的新赛道，大家站在相对接近的起跑线上。刻蚀设备的突破，代表国内已经拿到这条赛道的入场资格，不用完全跟在海外成熟路线后面亦步亦趋。
存储芯片的竞赛已经彻底改写，比拼的不再只是平面微缩，而是垂直堆叠的工程能力。
放眼整个产业链，你觉得国产厂商能不能借着 3D DRAM 这条新赛道，真正实现换道突破？
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